想象你收到一份米其林三星主厨的菜谱:低温慢煮和牛、榛子脆片、泡沫酱汁。写得精致,但你的厨房只有一口炒锅、一个蒸锅和一台微波炉。硬照着做,火候全不对;聪明的做法是把菜谱改写成“隔水小火炖、平底锅烘坚果”——步骤变了,端上桌的味道却要尽量贴近原版。做这个改写的人,就是“菜谱翻译官”,而他的工作,正像量子电路编译。 为什么要在讲 DNA 存储时聊这个?因为 DNA 存储用 A、T、C、G 四种碱基当“字母”存数据,DNA 计算靠碱基互补配对完成运算;量子计算和 DNA 计算同属“可逆计算”家族——信息经过每一步操作都不丢失、可以倒推。DNA 实验需要“编译”:把想要的逻辑操作翻译成 PCR、酶切、连接等标准实验步骤;量子计算机也需要“编译”:把抽象的量子算法翻译成硬件真正支持的“基本量子门”。今天,我们就跟着这位菜谱翻译官,看看他在量子厨房里如何拆解菜式、调整顺序、分配灶台、最后端出一盘可口的菜。
学懂量子电路编译,你就掌握了让量子算法在真实硬件上“落地”的核心技能——这是量子计算从论文走向工程的关键一环,也是量子软件工程师岗位最看重的硬实力。
目录
可视化演示
展示门分解与线路重排、量子比特映射策略及编译优化保真度提升,交互切换理解量子编译核心技术。
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编译流程总览:从高级菜谱到家常厨房
翻译官拿到米其林菜谱后,第一件事不是抄写,而是对照家里的设备清单:有几口锅、几个灶、火力上限多少。原料再好,锅不够热也白搭。他把这次“设备盘点”记在心头,才开始动笔改写——这就像量子编译器首先要收集硬件约束:这台机器支持哪些门、比特之间怎么连接、噪声多大。
在量子计算里,算法设计者通常假设一切理想:任意两个比特都能直接互动,门想加就加。这份“理想菜谱”叫逻辑量子电路;而真实的量子芯片只支持有限的原生门集合(比如超导芯片的 CZ 门、离子阱的 MS 门),并且比特之间的连接有严格拓扑。编译器的工作,就是把逻辑电路“翻译”成满足硬件约束的物理电路,中间隔着三道工序:门分解(把大操作拆成基础门)、量子比特映射(把逻辑比特安排到物理比特上)、脉冲调度(把门变成控制信号)。
整条线路的作用,其实可以浓缩成一个数学对象:一个大的酉矩阵,它被拆成一个个小门的矩阵乘积。
翻译官把整份菜谱“读薄”成一张等价操作清单后,接下来就要动手把每道复杂技法拆成家常基本功——这就是门分解。
- 作用顺序量子线路从左到右执行,矩阵连乘时最先作用的门写在最右边,因此 $U_1$ 是第一个被执行的量子门,读式子时应从右往左读。
- 总酉验证整条线路可以合并成一个等价的总体酉矩阵,这让我们能在数学上检查“改写前后是否等价”。
- 可逆性体现每个门都必须可逆,即满足 $U_i^{\dagger} = U_i^{-1}$,这与 DNA 存储中“信息不丢失、可倒推”的原理一脉相承。
门分解策略:把分子料理拆成家常基本功
主厨的菜谱里有“低温慢煮”“液氮急冻”这类分子料理技法,家里没有真空机和液氮罐。翻译官的做法是:用“切、炒、蒸、煮”这些基本功组合,在误差可接受的范围内复刻出同样的口感。微波炉做不到 55°C 恒温,那就“小火隔水炖”,温度有点波动,但味道八九不离十——这就是门分解的思想。
门分解(gate decomposition),就是把算法中允许出现的任意量子门,改写成硬件原生支持的那几个“基本功”门的序列。硬件厂商会公布自己的通用门集合,比如 {CNOT, H, S, T},意思是:只要你会这四个基本动作,就能组合出任何量子操作。这里有一个漂亮的数学定理叫 Solovay-Kitaev 定理:任意单比特门,都能用 $O(\log^c(1/\varepsilon))$ 个基本门逼近到误差 $\varepsilon$ 以内。想做得更精细,门数只会“温和地”增长,而不是爆炸。
翻译官把每道复杂技法都拆成基本功后,又面临新问题:这些步骤先做哪个、后做哪个?家里只有一个灶,顺序不对就得干等——这就是线路重排要解决的难题。
- 误差度量用算符范数衡量原门 $U$ 与逼近序列 $V$ 的差距,差距必须控制在阈值 $\varepsilon$ 以内。
- 门数伸缩要想误差更小,所需基本门数按 $O(\log^c(1/\varepsilon))$ 增长——精度翻倍,门数只增加一点点。
- 阈值设定$\varepsilon$ 通常取硬件能容忍的噪声水平附近,太小会让线路臃肿,太大则味道跑偏。
线路重排优化:调整做菜顺序,让灶台不空转
炖牛肉要一个半小时,但真正需要你站在锅前的只有前十分钟。翻译官会把“切配菜”“调酱汁”塞进炖肉的等待时间里;如果两道菜互不干扰,他甚至会交换它们的制作顺序,让每个灶台都满满当当。他把这种“可提前、可对调”的步骤叫做能对易的操作。
量子线路里,门与门之间也有类似的对易(commutation)关系。如果两个门作用在完全不同的比特上,它们天然可以交换顺序;有些作用在同一比特上的特殊组合也能交换,比如 CNOT 门的控制位和 H 门就有部分对易性质。编译器扫描整条线路,把能移动的门尽量挪到有利位置:挪完之后,原本分散的“连续两个 H 门”碰到一起,直接抵消;相位门连成一串,合并成单个旋转——这叫相位门传播和模板消除,最终线路变得更短。
顺序排好了,翻译官又发现一个更头疼的问题:菜谱假设你有五个灶,家里只有两个。哪道菜放哪个灶?如果两道菜需要同时用相邻的锅,而它们偏偏离得远,还得临时挪锅——这正是量子比特映射的舞台。
- 对易子定义$[A,B] = AB - BA$ 量化了两个操作“谁先谁后的差别”,这是判断门能否移动的判据。
- 零则交换当对易子为零时,$AB = BA$,编译器就能把门在时间轴上自由拖动,寻找更紧凑的排布。
- 相邻合并两个相同的门(如 H)连续出现时互相抵消,相当于什么也没做——翻译官会把这种“多余的步骤”直接划掉。
量子比特映射:分配灶台与挪锅的艺术
菜谱的“理想厨房”是五个灶台围成一圈,任意两个灶可以同时操作;你家的现实厨房只有两个灶,排成一列,灶与灶之间只能相邻配合。翻译官的应对分两步:先决定哪道菜用哪个灶,这叫初始映射;如果某两步需要合作的两个锅离得远,就沿着一串中间灶台把锅“挪”过去——每挪一次,就多花一次时间和精力,这叫 SWAP 路由。
量子芯片的物理比特就是这些“灶台”,它们之间的连接通常被限制成近邻拓扑(一维链或二维网格),不可能让任意两个比特直接执行双比特门。编译器必须为每个逻辑比特分配一个物理比特,然后对每个双比特门检查:两个比特在物理图上离多远?不相邻,就插入一串 SWAP 门,把它们一路“搬”到彼此身边。SWAP 门本身也耗费时间、引入噪声,所以好的编译器会反复搜索,找一个让总“挪锅距离”最小的映射方案——常用启发式搜索或模拟退火。
翻译官发现,光靠人脑算这些太累了。他决定写一个“智能厨房管家”——只要把菜谱放进去,自动完成拆解、排程、分灶、优化——这就是自动化工具链。
- 路径距离$d(p_a, p_b)$ 表示两个物理比特在芯片拓扑图上的最短路径长度——“两灶相距几格”。
- 单门绕路费相距 $d$ 时需要 $d-1$ 次 SWAP 才能让两比特相邻;距离为 1 时直接执行,无需额外开销。
- 总代价求和对所有双比特门累计,编译器用这个数值来比较不同初始映射方案的好坏,取成本最小者。
自动化工具链:请来一位智能厨房管家
翻译官的日常工作越来越繁重:几十道菜、几十个灶、不同的锅具火力,全手工算会疯掉。于是他开发了一款 App:拍一下菜谱,自动识别食材,匹配家里设备,改写成步骤清单,连采购列表都排好。这台“自动改写机器”,就是量子编译器框架。
现代量子编译器采用分层架构,和经典编译器的思路很像:前端把高级语言写的量子程序解析成中间表示(IR),比如 QIR、MLIR 这类标准化格式;中间层跑一串优化 Pass,包括门分解、线路重排、比特映射、SWAP 路由、深度压缩,每个 Pass 像 App 里的一个功能模块,可插拔、可复用;后端则针对具体硬件生成原生门序列和操控脉冲——后端适配的意思是:同一份中间表示,换一个“后端插件”就能适配超导芯片、离子阱芯片或光量子芯片,就像同一份菜谱,在电磁炉厨房和燃气灶厨房各有不同做法。
管家 App 上线后,翻译官终于有精力思考一个更本质的问题:怎么判断一份改写得“好”?仅仅是步骤少吗?如果最后菜的味道跑偏了呢?他需要一套评分标准。
- 分解步骤内层的 $\operatorname{Decompose}(P, B)$ 把高级电路 $P$ 降维到后端 $B$ 支持的门集合,相当于“分子料理拆成家常基本功”。
- 路由步骤$\operatorname{Route}(C', B)$ 依据后端拓扑给比特排位置,必要时插入 SWAP 门,对应“分配灶台”。
- 优化步骤最外层的 $\operatorname{Optimize}$ 对整条线路再做一次全局压缩,删掉冗余门,进一步减小深度。
性能与权衡:好不好吃,用数据说话
翻译官给每份改写方案打了四张评分卡:上菜时长(线路深度——多少轮串行操作才能出锅)、复刻还原度(执行保真度——每步操作的成功率有多高)、食材消耗(门总数,尤其是昂贵的 T 门数量)、招待能力(可扩展性——这套方案能应付几十人甚至几百人的宴席吗)。他很快发现,这四项常常互相打架:想缩短时长,就得并行更多操作,可能提高出错率;想提高还原度,就得减少门,可分解更精细又需要更多门。
量子线路中,保真度有一个无情的规律:每个门都有一定概率出错,整条线路成功,要求所有门都成功。门一多,成功率就像滚雪球一样往下掉——这解释了一个反直觉的事实:减少门数往往比减少深度更优先。于是编译器设计者需要在精度(分解误差小)、效率(编译和运行都快)、可扩展性(支持大规模比特)之间反复权衡,并用基准测试集(如 Quantum Volume、QASMBench)来公平打分。
翻译官终于明白:编译不是“找到唯一最优解”,而是“在厨房现实与菜品理想之间找平衡”。他拿着四张评分卡,挑出最适合今晚宴席的那一版菜谱——一份好的量子电路编译方案,也正是这样从无数次权衡中走出来的。
- 单门成功率$F_i$ 是第 $i$ 个门执行正确的概率,受硬件噪声影响,总是略小于 1。
- 整体连乘整条线路成功要求所有门都成功,因此总保真度是所有单门保真度的乘积。
- 小误差近似当每个门失败率 $1-F_i$ 都很小时,总失败率近似等于各失败率之和——直观地看,门数每翻一倍,成功概率就按指数往下掉。
AI 应用场景
量子云平台自动后端适配
阶段:模型部署与推理优化
解决的问题:量子计算云平台上芯片型号繁多,超导、离子阱、光量子各自支持不同的门集合和连接拓扑。算法开发者不想为每台机器手写电路,传统方式费时且极易出错。编译器工具链自动完成门分解、比特映射和脉冲调度,开发者只需提交逻辑电路,平台自动适配后端。
具体案例:IBM Quantum 的 Qiskit 编译器接收用户线路后,自动针对某个具体 backend 的 CZ 门集合做重写,并按芯片的耦合图做拓扑感知映射;阿里云量子开发平台同样内置了多后端编译流水线,一行配置即可切换模拟器与真实芯片。
变分量子算法中的电路裁剪
阶段:模型训练前处理
解决的问题:VQE 等变分量子算法的线路深度常超出硬件相干时间的承受范围,直接运行保真度极低。编译优化通过门分解、重排和映射,把电路裁剪到硬件“咬得动”的深度。
具体案例:某量子化学团队对一个 12 比特的 VQE 线路做编译优化,采用模板消除减少冗余门、用启发式映射减少 SWAP,最终线路深度从 200 多降到 60 多,T 门数减少四成,在真实芯片上的实验成功率提升近一倍。
DNA 计算协议的“编译器”设计思路迁移
阶段:协议设计与合成验证
解决的问题:DNA 计算把逻辑运算映射到生化反应上,步骤多、易出错,实验设计极其繁琐。借鉴量子编译的分层思想,把“逻辑 DNA 电路”编译成“标准分子操作协议”(PCR、酶切、连接),并用仿真器评估每一步的产出率与保真度。
具体案例:研究团队将复杂的 DNA 逻辑门拆解为有限的 DNA 链置换(DSD)基本模块,像量子门分解一样组合复用,实现了可与硅基电路类比的可扩展 DNA 计算网络——这正是“可逆计算家族”内部相互启发的生动例子。
Python 演示
"""Minimal quantum circuit compiler: logical-to-physical mapping with SWAP routing.""" class LogicalCircuit: """A logical circuit that assumes all-to-all connectivity.""" def __init__(self): self.gates = [] # each gate: (name, q1, q2); q2 == -1 means single-qubit gate def cx(self, q1, q2): self.gates.append(("CX", q1, q2)) def single(self, name, q): self.gates.append((name, q, -1)) class PhysicalRouter: """Map a logical circuit onto a physical chip with limited connectivity.""" def __init__(self, n_phys, edges): self.n = n_phys self.edges = edges # neighbor table: phys_bit -> [phys_bits] self.l2p = {i: i for i in range(n_phys)} # logical -> physical self.p2l = {i: i for i in range(n_phys)} # physical -> logical self.output = [] # compiled physical circuit self.swap_count = 0 def _shortest_path(self, start, goal): parent = {start: None} queue = [start] while queue and goal not in parent: cur = queue.pop(0) for nb in self.edges[cur]: if nb not in parent: parent[nb] = cur queue.append(nb) path = [] node = goal while node is not None: path.append(node) node = parent[node] return path[::-1] def _swap_along_path(self, pa, pb): path = self._shortest_path(pa, pb) swaps = [] for i in range(len(path) - 2): swaps.append((path[i], path[i + 1])) return swaps def _apply_swap(self, pa, pb): self.output.append(("SWAP", pa, pb)) la, lb = self.p2l[pa], self.p2l[pb] self.l2p[la], self.l2p[lb] = pb, pa self.p2l[pa], self.p2l[pb] = lb, la self.swap_count += 1 def compile(self, circuit): for name, q1, q2 in circuit.gates: if q2 == -1: self.output.append((name, self.l2p[q1])) else: pa, pb = self.l2p[q1], self.l2p[q2] for s1, s2 in self._swap_along_path(pa, pb): self._apply_swap(s1, s2) pa, pb = self.l2p[q1], self.l2p[q2] self.output.append((name, pa, pb)) return self.output def main(): # A 1-D chain: 0 - 1 - 2 - 3 n_phys = 4 edges = {0: [1], 1: [0, 2], 2: [1, 3], 3: [2]} router = PhysicalRouter(n_phys, edges) circuit = LogicalCircuit() circuit.cx(0, 2) # logical qubit 0 and 2 want to interact circuit.cx(0, 3) circuit.single("T", 1) circuit.cx(0, 3) compiled = router.compile(circuit) for gate in compiled: print(gate) print("inserted SWAP count:", router.swap_count) if __name__ == "__main__": main()
self.l2p = {i: i for i in range(n_phys)}初始映射:先假设逻辑比特放在同编号的物理比特上,这是“菜谱默认五灶”的理想起点。self.output.append(("SWAP", pa, pb))每当需要挪锅,就往物理电路里写入一个 SWAP 门,并累加计数器。path = self._shortest_path(pa, pb)在芯片拓扑图上用 BFS 找两个物理比特之间的最短路径,决定“往哪个方向挪”。for s1, s2 in self._swap_along_path(pa, pb):一路交换相邻比特,像端着锅沿灶台一步步挪到目标旁边。self.l2p[la], self.l2p[lb] = pb, pa交换后立即更新逻辑到物理的映射表,确保后续门操作始终知道“人在哪”。self.output.append((name, pa, pb))两个比特终于相邻,这时才放下真正的双比特门(CX),完成一次“远程互动”。if __name__ == "__main__":程序入口:构造四比特一维链硬件,编译一小段逻辑电路并打印结果。
常见误区
误区我只要写出了量子算法,把它交给编译器,随便哪台量子计算机都能跑;编译不就是软件层面的翻译和优化吗?硬件细节应该早就被封装好了。
正解量子硬件差异极大——超导芯片的比特连接像二维网格,离子阱芯片则是“所有离子围成一圈”的全连接结构,两者支持的原生门也完全不同。编译器必须精确知道后端的门集合、拓扑和噪声模型,才能做出有效分解与映射。没有“一次编译,处处运行”这回事;编译与硬件是深度绑定的,就像同一份菜谱在电磁炉厨房和柴火灶厨房必须有不同的做法。
为何常见:经典软件领域“一次编译到处运行”(Java 虚拟机等)太深入人心,初学者容易把这个经验直接类推到量子世界,忽略了底层物理的巨大异构性。
误区编译器优化的目标就是让门数量最少,门越少线路越短,执行肯定越快越准,所以数清楚总门数就够了。
正解不同量子门的代价天差地别。SWAP 门内部由 3 个 CNOT 组成,代价昂贵;T 门在容错架构里需要用数千个物理门通过蒸馏得到,更是不折不扣的“奢侈品”。有时增加总门数、但把昂贵的 T 门替换成便宜的 Clifford 门,整体代价反而更低。编译器优化的是“加权总代价”,而不是简单的门数统计——就像记账不能只数票数,还要看每张票面额多大。
为何常见:日常经验里“东西越少越省”直觉很强,但量子计算里“门的价格”不统一,只有深入理解门集合的物理实现,才能破除这个直觉。
误区教材说线路深度越浅,量子比特受退相干影响越小,所以只要我拼命压缩深度,执行保真度肯定会变好。
正解深度只衡量串行步数,并不等于总门数或总误差。压缩深度可能靠重排实现(不增加误差),也可能靠插入更多并行门实现(增加了总门数);如果为压缩深度而额外引入高错误率的门,保真度反而下降。深度优化和保真度优化是两个相互拉扯的目标,必须放在同一个评分卡里权衡——就像缩短上菜时间可以,但如果因此把牛肉炖夹生了,厨艺评分反而更低。
为何常见:教材强调“深度与退相干成正比”,让人误以为深度是唯一决定保真度的因素,忽略了门错误率、串扰等其他噪声来源。
误区把逻辑比特映射到物理比特不就是编号吗?随手分配一个,距离远了就插 SWAP,反正 SWAP 也是门,多几个大不了慢一点。
正解初始映射的质量直接决定总 SWAP 数量,而每个 SWAP 相当于 3 个 CNOT 门,会成倍放大时间和噪声。好的编译器会用启发式搜索、模拟退火甚至动态规划在可接受时间内找到近似最优映射;乱映射再加鲁莽补 SWAP,会让线路迅速膨胀到不可用。这好比厨房里锅放得乱七八糟,每次做菜都要端着热锅穿越整个厨房,既费时又危险——提前把锅摆对位置,远比事后狂奔高明。
为何常见:初学者容易把 SWAP 当成免费的无害操作,忽略了它在物理层面由多个 CNOT 构成、同样引入误差,于是低估了映射环节的重要性。
面试题
Q1. 量子电路编译的首要目标,是把高级算法电路转换为( )
- A.硬件支持的原生门序列← 正确答案
- B.更复杂的逻辑电路
- C.经典逻辑门电路
- D.任意随机门序列
答案:A。编译的产出物是物理电路,它只包含目标量子硬件原生支持的门的序列,并且满足芯片的连通拓扑约束。B 和 C 方向完全相反,D 更不可能。就像翻译官最终交出的菜谱,必须用家里真实存在的锅具完成。
Q2. 在门分解中,Solovay-Kitaev 定理的核心结论是( )
- A.单比特门可近似分解为基本门序列← 正确答案
- B.任意门都能精确分解为单位矩阵
- C.所有量子门都可以完全消除
- D.分解后的门数量与精度无关
答案:A。该定理保证任意单比特门都能用基本门序列逼近,且误差越小所需门数只按对数多项式增长。B 把“分解”偷换成“消除”,C 与门分解本质矛盾,D 与定理强调的精度—门数权衡相反。
Q3. 关于量子比特映射,以下说法正确的是( )
- A.需要满足芯片的近邻耦合拓扑约束← 正确答案
- B.逻辑比特可直接映射到任意物理比特
- C.SWAP 门插入不会产生额外开销
- D.映射过程与硬件噪声完全无关
答案:A。量子芯片只允许相邻比特执行双比特门,映射必须满足近邻拓扑约束。B 忽略物理连接限制,C 忽略了 SWAP 由 3 个 CNOT 构成、代价高昂,D 与事实相反——噪声正是映射优化的重要考量。
Q4. 量子线路重排优化所依赖的关键性质是( )
- A.门之间的对易可交换性← 正确答案
- B.量子态的测量塌缩
- C.经典比特的布尔运算
- D.电路中的随机噪声
答案:A。只有两个操作对易(可交换顺序)时,编译器才能安全地移动门的位置,进而实现合并、抵消和深度压缩。测量塌缩是运行时的物理现象,不是重排的理论依据;布尔运算属于经典计算,随机噪声则是要抑制的对象。
Q5. 编译器把逻辑电路转化为物理电路时,负责给比特安排物理位置的组件是( )
- A.脉冲调度器
- B.波形整形器
- C.量子比特映射器← 正确答案
- D.经典前端解析器
答案:C。量子比特映射器专门处理逻辑比特到物理比特的分配,并负责插入 SWAP 门完成路由。脉冲调度器负责把门变成时序控制信号,波形整形器处理微波脉冲形状,经典前端解析器只负责语法解析,都不管“比特住哪间房”。
Q6. 设每个门成功率为 99%,执行 100 个门后,线路总成功率约( )
- A.成功率约剩百分之三十六← 正确答案
- B.成功率基本不受影响
- C.成功率直接降为零
- D.成功率变为百分之九十九
答案:A。总保真度约等于各门保真度连乘:0.99^100 ≈ 0.366。这说明门数量对成功率的影响是指数级的,也解释了编译器为什么拼命减少门数。B、C、D 分别犯了“误差不积累”“直接归零”“只看单门”三个典型错误。
Q7. 当量子芯片只支持一维近邻连接时,实现两个远端比特的 CX 门通常需要( )
- A.直接远程绕线连接
- B.插入一串 SWAP 门调整位置← 正确答案
- C.改用经典通信传输
- D.忽略不连接直接执行
答案:B。一维链上两个不相邻的物理比特无法直接执行双比特门,编译器会沿最短路径插入一串 SWAP 门,把两个逻辑比特“搬运”到相邻位置后再执行 CX。A 不满足物理顶层布线限制,C 把量子门降级成了经典通信,D 违背了门的基本语义。
Q8. 在量子编译研究中,“可扩展性”主要指( )
- A.编译算法能支撑大规模比特← 正确答案
- B.硬件体积可以无限增大
- C.门数量可以无限增加
- D.噪声可以完全被消除
答案:A。可扩展性关注的是:当量子比特数从几十增长到几千甚至更多时,编译器是否还能在可接受的时间内完成编译、优化效果是否还能保持。B 是硬件工程问题,C 恰恰是要被优化抑制的,D 在物理上不现实。
Q9. 编译器后端适配时,需要根据目标硬件考虑哪些约束?( )
- A.超导与离子阱门集合差异← 正确答案
- B.量子比特的连通性拓扑结构← 正确答案
- C.原生门错误率噪声差异← 正确答案
- D.经典桌面界面的样式
答案:ABC。后端适配本质上是“把菜谱改成这台厨房能做的版本”:门集合决定了分解目标,拓扑决定映射与 SWAP 路由,错误率决定优化策略(比如优先减少高错误率的门)。D 是毫无关系的干扰项。
Q10. 关于量子线路中的 T 门优化,下列说法正确的是( )
- A.减少 T 门数量常作为编译优化目标← 正确答案
- B.T 门在容错架构中实现代价高昂← 正确答案
- C.T 门与 S 门相似但旋转角度不同← 正确答案
- D.T 门数量与线路深度完全无关
答案:ABC。T 门在容错架构中需要魔法态蒸馏,物理代价极高,因此“减少 T 门数量”是编译优化的经典目标;T 门是 π/4 相位旋转,S 门是 π/2,二者确实相似但角度不同。D 错误:T 门虽然作用在单比特上,但它的时间槽计入线路深度,数量与深度不可能完全无关。